Verilog HDL门时延
Verilog HDL实例数组
Verilog HDL简单示例
Verilog HDL 2-4解码器举例
Verilog HDL 连接运算符
Verilog HDL条件语句
Verilog HDL 结构建模--模块端口
Verilog HDL 结构建模实例化语句
Verilog HDL 数据流建模 --连续赋值语句
Verilog HDL 数据流建模--*-阻塞赋值语句
Verilog HDL行为建模--- 过程赋值语句
Verilog HDL行为建模具体实例
verilog HDL 结构化建模具体实例
精简的FPGA编程方法
中芯与Magma合作ASIC设计项目
Xilinx:为FPGA更光明的未来作准备
FAST电路
用FPGA实现非标码速向标准码速的调整
容错系统中的自校验技术及实现方法
从FPGA转换到门阵列
FPGA设计中关键问题的研究
VGA图像控制器的CPLD/FPGA设计与实现
低电压PLD/FPGA的供电设计
用XC9500 CPLD和并行PROM配置Xilinx FPGA
Verilog HDL 建模概述
Verilog HDL 主要功能list
Verilog HDL时延
Verilog HDL 基本语法--标识符
Verilog HDL 中有两种注释的方式
Verilog HDL数字值集合
Verilog HDL数据类型
Verilog HDL算术运算符
Verilog HDL逻辑运算符
FPGA正进一步蚕食ASIC和ASSP的应用市场
ASIC设计工具简单介绍
采用结构化ASIC设计方法来构建复杂的ASIC(一)
数字电路设计EDA工具
模拟/数.模混合信号电路设计EDA工具
Hard/Soft协调设计EDA工具
LSI Layout设计EDA工具
PLD/FPGA 结构与原理初步(一)
测试设计EDA工具
印刷电路版设计的EDA工具
AC/DC设计、工艺模拟、器件模拟的EDA工具
ASIC设计流程
平台ASIC架构突破传统ASIC设计局限性
采用结构化ASIC设计方法来构建复杂的ASIC(二)
PLD/FPGA 结构与原理初步
FPGA设计流程
.离心喷淋式化学清洗抛光硅片
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